Verilog數字系統設計教程（第3版）

內容簡介

本書講述了利用硬體描述語言(VerilogHDL)設計複雜數字系統的方法。這種方法源自20世紀90年代的美國在美國取得成效後迅速在其他先進工業國得到推廣和普及。利用硬體描述語言建模、通過仿真和綜合技術設計出極其複雜的數字系統是這種技術的優勢。

本書從算法和計算的基本概念出發講述如何用硬線邏輯電路實現複雜數字邏輯系統的方法。全書共四部分。第一部分Verilog數字設計基礎與第二部分Verilog數字系統設計和驗證共18章;第三部分共12個上機練習實驗範例;第四部分是Verilog硬體描述語言參考手冊可供讀者學習、查詢之用。本書第3版後在語法篇中增加了IEEEVerilogl3642001標準簡介以反映Verilog語法的新變化。

本書的講授方式以每2學時講授一章為宜每次課後需要花10h來複習思考。完成10章學習後就可以開始做上機練習從簡單到複雜由典型到一般循序漸進地學習VerilogHDL基礎知識。按照書上的步驟可以使大學電子類及計算機工程類本科及研究生以及相關領域的設計工程人員在半年內掌握VerilogHDL設計技術。

本書可作為電子工程類、自動控制類、計算機類的大學本科高年級及研究生教學用書亦可供其他工程人員自學與參考。

圖書目錄

緒論

第一部分 Verilog數字設計基礎

第1章 Verilog的基本知識

1.1 硬體描述語言HDL

1.2 Verilog HDL的歷史

1.2.1 什麼是Verilog HDL

1.2.2 Verilog HDL的產生及發展

1.3 Verilog HDL和VHDL的比較

1.4 Verilog的套用情況和適用的設計

1.5 採用Verilog HDL設計複雜數字電路的優點

1.5.1 傳統設計方法——電路原理圖輸入法

1.5.2 Verilog HDL設計法與傳統的電路原理圖輸入法的比較

1.5.3 Verilog的標準化與軟核的重用

1.5.4 軟核、固核和硬核的概念及其重用

1.6 採用硬體描述語言(Verilog HDL)的設計流程簡介

1.6.1 自頂向下(Top_Down)設計的基本概念

1.6.2 層次管理的基本概念

1.6.3 具體模組的設計編譯和仿真的過程

1.6.4 具體工藝器件的最佳化、映像和布局布線

小結

思考題

第2章 Verilog語法的基本概念

概述

2.1 Verilog模組的基本概念

2.2 Verilog用於模組的測試

小結

Verilog數字系統設計教程（第3版）

基本介紹

內容簡介

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