數字邏輯電路基礎與計算機系統集成技術

數字邏輯電路基礎與計算機系統集成技術

《數字邏輯電路基礎與計算機系統集成技術》是2012年8月清華大學出版社出版的圖書,作者是解本巨、杜軍威、岳學海、龐志永。

基本介紹

  • 書名:數字邏輯電路基礎與計算機系統集成技術
  • 作者:解本巨 杜軍威 岳學海 龐志永編著
  • ISBN:9787302288138
  • 頁數:270
  • 定價:29.50元
  • 出版社:清華大學出版社
  • 出版時間:2012-8
內容介紹,用途價值,圖書目錄,

內容介紹

《21世紀高等學校規劃教材·計算機科學與技術:數字邏輯電路基礎與計算機系統集成技術》是以EDA技術研究為出發點,專門針對計算機科學與技術專業而編寫的硬體技術基礎教程。與以往的數字電路教材不同,,《數字邏輯電路基礎與計算機系統集成技術》重點體現“軟體設計實現硬體技術”的理念,除了在傳統基礎上利用真值表、狀態圖、卡諾圖化簡進行組合邏輯電路、時序邏輯電路設計外,還專門介紹了QuartusⅡ9.1開發環境和硬體設計語言Verilog HDL,並使用Verilog HDL語言實現組合電路設計、同步,異步時序電路設計,晶片擴展套用,PLD設計,接口電路設計,數字系統fpga項目設計及簡單微處理器設計等,其他內容還包括邏輯門實現、組合邏輯電路和時序邏輯電路分析、存儲器設計與擴展、脈衝發生器設計、A/D和D/A轉換電路、數字系統設計等。在設計分析中,能夠把設計的電路晶片與計算機系統有機地結合起來。 《數字邏輯電路基礎與計算機系統集成技術》可作為高等院校本科生的教材,還可作為技術開發人員的參考資料。

用途價值

《21世紀高等學校規劃教材·計算機科學與技術:數字邏輯電路基礎與計算機系統集成技術》重點體現“軟體設計實現硬體技術”的理念,除了在傳統基礎上利用真值表、狀態圖、卡諾圖化簡進行組合邏輯電路、時序邏輯電路設計外,還專門介紹了Quartus Ⅱ 9.1開發環境和硬體設計語言Verilog HDL,並使用Verilog HDL語言實現組合電路設計、同步,異步時序電路設計,晶片擴展套用,PLD設計,接口電路設計,數字系統FPGA項目設計及簡單微處理器設計等,其他內容還包括邏輯門實現、組合邏輯電路和時序邏輯電路分析、存儲器設計與擴展、脈衝發生器設計、A/D和D/A轉換電路、數字系統設計等。在設計分析中,能夠把設計的電路晶片與計算機系統有機地結合起來。

圖書目錄

第1章數字邏輯基礎
1.1電路引入二進制、晶片及集成概念
1.2數制與數制轉換
1.2.1計算機中常用進位計數制
1.2.2數制轉換
1.2.3二進制算術運算
1.3計算機中常用編碼
1.3.1二十進制編碼
1.3.2格雷碼
1.3.3ASCII碼
1.4邏輯運算與邏輯代數
1.4.13種基本邏輯運算
1.4.2邏輯函式及其表示方法
1.4.3邏輯代數
1.5邏輯代數的卡諾圖化簡法
1.5.1最小項的定義及其性質
1.5.2邏輯函式的最小項表達式
1.5.3用卡諾圖表示邏輯函式
1.5.4用卡諾圖化簡邏輯函式
第2章硬體描述語言Verilog HDL與編輯環境Quartus Ⅱ
2.1硬體描述語言Verilog HDL設計方法學簡介
2.1.1Verilog的基本語法規則
2.1.2變數及數據類型
2.1.3運算符和表達式
2.1.4語句
2.2Verilog HDL建模
2.2.1Verilog HDL程式的基本結構
2.2.2結構建模
2.2.3數據流建模
2.2.4行為建模
2.2.5模組調用
2.3Verilog HDL編譯環境Quartus Ⅱ 9.1
2.3.1Quartus Ⅱ 9.1概述
2.3.2Quartus Ⅱ 9.1原理圖設計方法
2.3.3使用Verilog HDL語言實現數字電路設計
2.3.4波形仿真
第3章邏輯門電路
3.1半導體器件組成的門電路
3.1.1半導體器件的開關特性
3.1.2分立元件門電路
3.2CMOS門電路
3.2.1CMOS反相器
3.2.2CMOS邏輯門電路
3.2.3CMOS漏極開路門與三態門電路
3.2.4CMOS傳輸門
3.3TTL門電路
3.3.1TTL反相器的基本電路
3.3.2TTL邏輯門電路
3.3.3TTL集電極開路門與三態門電路
第4章組合邏輯電路
4.1組合邏輯電路分析
4.2組合邏輯電路設計
4.3組合電路的競爭與冒險
4.3.1冒險的分類與產生原因
4.3.2冒險的判斷與消除方法
4.4常用組合邏輯電路
4.4.1編碼器
4.4.2解碼器
4.4.3數據選擇器
4.4.4比較器
4.4.5算術運算電路
第5章時序邏輯電路
5.1時序邏輯電路基礎
5.1.1觸發器
5.1.2時序邏輯電路的描述
5.2時序邏輯電路記憶單元——觸發器
5.2.1RS觸發器
5.2.2D觸發器
5.2.3JK觸發器
5.2.4T觸發器
5.2.5用Verilog語言設計觸發器
5.3同步時序邏輯電路的分析與設計
5.3.1同步時序邏輯電路的分析
5.3.2同步時序邏輯電路的設計
5.4異步時序電路的分析與設計
5.4.1異步時序邏輯電路的分析
5.4.2異步時序邏輯電路的設計
5.5常用時序邏輯電路
5.5.1暫存器
5.5.2計數器
5.5.3順序脈衝發生器

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