或非門（英語：NOR gate）是數字邏輯電路中的基本元件，實現邏輯或非功能。有多個輸入端，1個輸出端，多輸入或非門可由2輸入或非門和反相器構成。只有當兩個輸入A和B為低電平（邏輯0）時輸出為高電平（邏輯1）。也可以理解為任意輸入為高電平（邏輯1），輸出為低電平（邏輯0）。
基本介紹
- 中文名：或非門
- 外文名：NOR gate
- 性質：電路元件
- 功能：實現邏輯或非的功能
- 適用領域：電路、邏輯等
- 套用學科：物理等
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基本功能
或非門是具有多端輸入和單端輸出的門電路。當任一輸入端(或多端)為高電平（邏輯“1”）時，輸出就是低電平（邏輯“0”）；只有當所有輸入端都是低電平（邏輯“0”）時，輸出才是高電平（邏輯“1”）。其邏輯關係的數學表達式為：
，其二輸入的或非門真值表如下表所示。
| 輸入A | 輸入B | 輸出Y |
|---|---|---|
0 | 0 | 1 |
0 | 1 | 0 |
1 | 0 | 0 |
1 | 1 | 0 |
邏輯符號
或非門有3種邏輯符號，包括：形狀特徵型符號（ANSI/IEEEStd 91-1984）、IEC矩形國標符號（IEC 60617-12）和DIN符號（DIN 40700），以二輸入或門為例，邏輯符號如圖所示：
實現
NMOS邏輯實現
上圖展示了使用NMOS線路的2輸入或非門的構造。如果輸入都是高電平，對應的NMOS就會接通，輸出會被拉到低電平；反之輸出會通過上拉電阻被拉到高電平。
CMOS邏輯實現
上圖展示了使用CMOS技術的2輸入或非門。輸出端的二極體和電阻用來保護CMOS元件，以防其受到靜電放電（ESD）的損害，從而在電路的邏輯功能中發揮不了作用。
其他方案
在絕大多數但不是所有的電路設計中，邏輯非的功能本身就包含在結構中，如CMOS和TTL等。在這樣的邏輯系列中，要實現或門，唯一的方法是用2個或更多的邏輯門來實現，如一個或非門加一個反相器。具體方法是將兩個輸入接在一起的與非門作為另外一個與非門的兩個輸入，然後在後者的輸出接一個輸入接在一起的與非門，即可實現或非門。注意任何邏輯門都可以用與非門的組合或或非門的組合實現。
通過與非門構建的或非門積體電路
 CD4000 |  CD4001 |  CD4002 |
 74X27 |  74X02 |
