Verilog HDL數字設計與綜合（第二版）（本科教學版）

內容簡介

本書從用戶的角度全面闡述了Verilog HDL語言的重要細節和基本設計方法，並詳細介紹了Verilog 2001版的主要改進部分。本書重點關注如何套用Verilog語言進行數字電路和系統的設計和驗證，而不僅僅講解語法。全書從基本概念講起，並逐漸過渡到程式語言接口以及邏輯綜合等高級主題。書中的內容全部符合Verilog HDL IEEE 1364-2001標準。

圖書目錄

第一部分 Verilog基礎知識

第1章 Verilog HDL數字設計綜述 2

1．1 數字電路CAD技術的發展歷史 2

1．2 硬體描述語言的出現 2

1．3 典型設計流程 3

1．4 硬體描述語言的意義 4

1．5 VERILOG HDL的優點 5

1．6 硬體描述語言的發展趨勢 5

第2章層次建模的概念 7

2．1 設計方法學 7

2．2 四位脈動進位計數器 8

2．3 模組 9

2．4 模組實例 10

2．5 邏輯仿真的構成 12

2．6 舉例 12

2．7 小結 15

2．8 習題 16

第3章基本概念 17

3．1 詞法約定 17

3．2 數據類型 20

3．3 系統任務和編譯指令 25

3．4 小結 29

3．5 習題 30

第4章模組和連線埠 31

4．1 模組 31

4．2 連線埠 33

4．3 層次命名 38

4．4 小結 39

4．5 習題 39

第5章門級建模 40

5．1 門的類型 40

5．2 門延遲 50

5．3 小結 54

5．4 習題 55

第6章數據流建模 56

6．1 連續賦值語句 56

6．2 延遲 58

6．3 表達式、操作符和運算元 59

6．4 操作符類型 60

6．5 舉例 67

6．6 小結 74

6．7 習題 74

第7章行為級建模 76

7．1 結構化過程語句 76

7．2 過程賦值語句 79

7．3 時序控制 83

7．4 條件語句 88

7．5 多路分支語句 89

7．6 循環語句 91

7．7 順序塊和並行塊 94

7．8 生成塊 98

7．9 舉例 103

7．10小結 108

7．11 習題 109

第8章任務和函式 112

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